spi
This commit is contained in:
3
.gitignore
vendored
3
.gitignore
vendored
@@ -4,5 +4,6 @@ build/
|
|||||||
bin/
|
bin/
|
||||||
.obj_dir/
|
.obj_dir/
|
||||||
obj_dir/
|
obj_dir/
|
||||||
.nvim/
|
*.nvim/
|
||||||
.cache/
|
.cache/
|
||||||
|
*.vcd/
|
||||||
|
|||||||
File diff suppressed because one or more lines are too long
@@ -2,7 +2,9 @@
|
|||||||
+incdir+/home/benk/projects/fpga-basics/Max10_VGA
|
+incdir+/home/benk/projects/fpga-basics/Max10_VGA
|
||||||
+incdir+/home/benk/projects/fpga-basics/Max1000 Template
|
+incdir+/home/benk/projects/fpga-basics/Max1000 Template
|
||||||
+incdir+/home/benk/projects/fpga-basics/Verilator_Tests/clk
|
+incdir+/home/benk/projects/fpga-basics/Verilator_Tests/clk
|
||||||
|
+incdir+/home/benk/projects/fpga-basics/Verilator_Tests/spi
|
||||||
+incdir+/home/benk/projects/fpga-basics/Max10_RT
|
+incdir+/home/benk/projects/fpga-basics/Max10_RT
|
||||||
+incdir+/home/benk/projects/fpga-basics/Max10_VGA
|
+incdir+/home/benk/projects/fpga-basics/Max10_VGA
|
||||||
+incdir+/home/benk/projects/fpga-basics/Max1000 Template
|
+incdir+/home/benk/projects/fpga-basics/Max1000 Template
|
||||||
+incdir+/home/benk/projects/fpga-basics/Verilator_Tests/clk
|
+incdir+/home/benk/projects/fpga-basics/Verilator_Tests/clk
|
||||||
|
+incdir+/home/benk/projects/fpga-basics/Verilator_Tests/spi
|
||||||
@@ -1,15 +1,5 @@
|
|||||||
module top (
|
module top (
|
||||||
input clk_25mhz,
|
input clk_25mhz
|
||||||
|
|
||||||
output h_sync,
|
|
||||||
output v_sync,
|
|
||||||
|
|
||||||
|
|
||||||
output [3:0] r,
|
|
||||||
output [3:0] g,
|
|
||||||
output [3:0] b
|
|
||||||
);
|
);
|
||||||
|
|
||||||
|
|
||||||
|
|
||||||
endmodule
|
endmodule
|
||||||
|
|||||||
@@ -6,19 +6,8 @@ module top_tb;
|
|||||||
|
|
||||||
reg clk_25mhz = 0;
|
reg clk_25mhz = 0;
|
||||||
|
|
||||||
wire h_sync, v_sync;
|
|
||||||
|
|
||||||
wire [3:0] r;
|
|
||||||
wire [3:0] g;
|
|
||||||
wire [3:0] b;
|
|
||||||
|
|
||||||
top uut (
|
top uut (
|
||||||
.clk_25mhz(clk_25mhz),
|
.clk_25mhz(clk_25mhz),
|
||||||
.h_sync(h_sync),
|
|
||||||
.v_sync(v_sync),
|
|
||||||
.r(r),
|
|
||||||
.g(g),
|
|
||||||
.b(b)
|
|
||||||
);
|
);
|
||||||
|
|
||||||
always #20 clk_25mhz = ~clk_25mhz;
|
always #20 clk_25mhz = ~clk_25mhz;
|
||||||
|
|||||||
@@ -2,18 +2,8 @@ $version Generated by VerilatedVcd $end
|
|||||||
$timescale 1ps $end
|
$timescale 1ps $end
|
||||||
$scope module TOP $end
|
$scope module TOP $end
|
||||||
$var wire 1 # clk_25mhz $end
|
$var wire 1 # clk_25mhz $end
|
||||||
$var wire 1 $ h_sync $end
|
|
||||||
$var wire 1 % v_sync $end
|
|
||||||
$var wire 4 & r [3:0] $end
|
|
||||||
$var wire 4 ' g [3:0] $end
|
|
||||||
$var wire 4 ( b [3:0] $end
|
|
||||||
$scope module top $end
|
$scope module top $end
|
||||||
$var wire 1 # clk_25mhz $end
|
$var wire 1 # clk_25mhz $end
|
||||||
$var wire 1 $ h_sync $end
|
|
||||||
$var wire 1 % v_sync $end
|
|
||||||
$var wire 4 & r [3:0] $end
|
|
||||||
$var wire 4 ' g [3:0] $end
|
|
||||||
$var wire 4 ( b [3:0] $end
|
|
||||||
$upscope $end
|
$upscope $end
|
||||||
$upscope $end
|
$upscope $end
|
||||||
$enddefinitions $end
|
$enddefinitions $end
|
||||||
@@ -21,11 +11,6 @@ $enddefinitions $end
|
|||||||
|
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||||||
#0
|
#0
|
||||||
1#
|
1#
|
||||||
0$
|
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||||||
0%
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|
||||||
b0000 &
|
|
||||||
b0000 '
|
|
||||||
b0000 (
|
|
||||||
#20
|
#20
|
||||||
0#
|
0#
|
||||||
#40
|
#40
|
||||||
|
|||||||
4
Verilator_Tests/spi/Makefile
Normal file
4
Verilator_Tests/spi/Makefile
Normal file
@@ -0,0 +1,4 @@
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|
VERILOG = top.v
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||||||
|
DEVICE = um-45k
|
||||||
|
|
||||||
|
include ./ulx4m.mk
|
||||||
29
Verilator_Tests/spi/sim_main.cpp
Normal file
29
Verilator_Tests/spi/sim_main.cpp
Normal file
@@ -0,0 +1,29 @@
|
|||||||
|
#include "Vtop.h"
|
||||||
|
#include "verilated.h"
|
||||||
|
#include "verilated_vcd_c.h"
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||||||
|
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|
int main(int argc, char** argv) {
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|
Verilated::commandArgs(argc, argv);
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|
Verilated::traceEverOn(true);
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|
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||||||
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Vtop* top = new Vtop;
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||||||
|
VerilatedVcdC* tfp = new VerilatedVcdC;
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|
top->trace(tfp, 99);
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|
tfp->open("wave.vcd");
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||||||
|
int clk = 0;
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|
for (int time = 0; time < 5000; time++) {
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|
// Toggle clk every 20 time units (simulate 25 MHz)
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||||||
|
if ((time % 20) == 0)
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|
clk = !clk;
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|
top->clk_25mhz = clk;
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top->eval();
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|
tfp->dump(time);
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|
}
|
||||||
|
|
||||||
|
tfp->close();
|
||||||
|
delete top;
|
||||||
|
return 0;
|
||||||
|
}
|
||||||
29
Verilator_Tests/spi/top.v
Normal file
29
Verilator_Tests/spi/top.v
Normal file
@@ -0,0 +1,29 @@
|
|||||||
|
module top (
|
||||||
|
input wire clk_25mhz,
|
||||||
|
|
||||||
|
output reg spi_clk = 0,
|
||||||
|
|
||||||
|
output reg spi_mosi = 0,
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||||||
|
input reg spi_miso = 0,
|
||||||
|
|
||||||
|
output wire spi_cs
|
||||||
|
);
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||||||
|
|
||||||
|
assign spi_cs = 0; // Always selected (for test)
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||||||
|
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||||||
|
reg [7:0] mosi_shift = 8'b01101011; // Example byte
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||||||
|
reg [3:0] bit_counter = 0;
|
||||||
|
reg spi_clk_en = 0;
|
||||||
|
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||||||
|
always_ff @(posedge clk_25mhz) begin
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||||||
|
spi_clk <= ~spi_clk;
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||||||
|
|
||||||
|
if (spi_clk == 0) begin
|
||||||
|
// Falling edge: shift data
|
||||||
|
spi_mosi <= mosi_shift[7];
|
||||||
|
mosi_shift <= {mosi_shift[6:0], 1'b0};
|
||||||
|
bit_counter <= bit_counter + 1;
|
||||||
|
end
|
||||||
|
end
|
||||||
|
|
||||||
|
endmodule
|
||||||
27
Verilator_Tests/spi/top_tb.v
Normal file
27
Verilator_Tests/spi/top_tb.v
Normal file
@@ -0,0 +1,27 @@
|
|||||||
|
// Copyright 2025 Benjamin Kyd, All Rights Reserved
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||||||
|
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||||||
|
`timescale 1ns / 1ps
|
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|
|
||||||
|
module top_tb;
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||||||
|
|
||||||
|
reg clk_25mhz = 0;
|
||||||
|
reg spi_clk, spi_mosi, spi_miso, spi_cs;
|
||||||
|
|
||||||
|
top uut (
|
||||||
|
.clk_25mhz(clk_25mhz),
|
||||||
|
.spi_clk(spi_clk),
|
||||||
|
.spi_mosi(spi_mosi),
|
||||||
|
.spi_miso(spi_miso),
|
||||||
|
.spi_cs(spi_cs)
|
||||||
|
);
|
||||||
|
|
||||||
|
always #20 clk_25mhz = ~clk_25mhz;
|
||||||
|
|
||||||
|
initial begin
|
||||||
|
$dumpfile("top_tb.vcd");
|
||||||
|
$dumpvars(0, top_tb);
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|
|
||||||
|
#500 $finish;
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||||||
|
end
|
||||||
|
|
||||||
|
endmodule
|
||||||
47
Verilator_Tests/spi/ulx4m.mk
Normal file
47
Verilator_Tests/spi/ulx4m.mk
Normal file
@@ -0,0 +1,47 @@
|
|||||||
|
PIN_DEF ?= ./ulx4m_v002.lpf
|
||||||
|
DEVICE ?= 85k
|
||||||
|
BUILDDIR = bin
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||||||
|
TOP ?= top
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||||||
|
VERILOG ?= $(wildcard *.v)
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||||||
|
|
||||||
|
compile: $(BUILDDIR)/toplevel.bit
|
||||||
|
|
||||||
|
prog: $(BUILDDIR)/toplevel.bit
|
||||||
|
fujprog $^
|
||||||
|
|
||||||
|
dfu: $(BUILDDIR)/toplevel.bit
|
||||||
|
dfu-util -a 0 -D $^ -R
|
||||||
|
|
||||||
|
sim: $(BUILDDIR)/sim.out
|
||||||
|
$^
|
||||||
|
|
||||||
|
$(BUILDDIR)/sim.out: $(VERILOG) sim_main.cpp
|
||||||
|
mkdir -p $(BUILDDIR)
|
||||||
|
verilator -Wall --cc $(VERILOG) \
|
||||||
|
--top-module top \
|
||||||
|
--exe sim_main.cpp \
|
||||||
|
--build -CFLAGS "-O2 -std=c++17" \
|
||||||
|
--trace \
|
||||||
|
--Wno-UNUSEDSIGNAL \
|
||||||
|
--Wno-UNDRIVEN \
|
||||||
|
--timing
|
||||||
|
cp obj_dir/Vtop $@
|
||||||
|
|
||||||
|
$(BUILDDIR)/toplevel.json: $(VERILOG)
|
||||||
|
mkdir -p $(BUILDDIR)
|
||||||
|
yosys \
|
||||||
|
-p "read -sv $^" \
|
||||||
|
-p "hierarchy -top ${TOP}" \
|
||||||
|
-p "synth_ecp5 -abc9 -json $@" \
|
||||||
|
|
||||||
|
$(BUILDDIR)/%.config: $(PIN_DEF) $(BUILDDIR)/toplevel.json
|
||||||
|
nextpnr-ecp5 --${DEVICE} --package CABGA381 --timing-allow-fail --freq 25 --textcfg $@ --json $(filter-out $<,$^) --lpf $<
|
||||||
|
|
||||||
|
$(BUILDDIR)/toplevel.bit: $(BUILDDIR)/toplevel.config
|
||||||
|
ecppack --compress $^ $@
|
||||||
|
|
||||||
|
clean:
|
||||||
|
rm -rf ${BUILDDIR} obj_dir
|
||||||
|
|
||||||
|
.SECONDARY:
|
||||||
|
.PHONY: compile clean prog dfu sim
|
||||||
397
Verilator_Tests/spi/ulx4m_v002.lpf
Normal file
397
Verilator_Tests/spi/ulx4m_v002.lpf
Normal file
@@ -0,0 +1,397 @@
|
|||||||
|
BLOCK RESETPATHS;
|
||||||
|
BLOCK ASYNCPATHS;
|
||||||
|
## ULX4M-LS v0.0.2
|
||||||
|
|
||||||
|
# The clock "usb" and "gpdi" sheet
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||||||
|
LOCATE COMP "clk_25mhz" SITE "G2";
|
||||||
|
IOBUF PORT "clk_25mhz" PULLMODE=NONE IO_TYPE=LVCMOS33;
|
||||||
|
FREQUENCY PORT "clk_25mhz" 25 MHZ;
|
||||||
|
|
||||||
|
# JTAG and SPI FLASH voltage 3.3V and options to boot from SPI flash
|
||||||
|
# write to FLASH possible any time from JTAG:
|
||||||
|
# SYSCONFIG CONFIG_IOVOLTAGE=3.3 COMPRESS_CONFIG=ON MCCLK_FREQ=62 SLAVE_SPI_PORT=DISABLE MASTER_SPI_PORT=ENABLE SLAVE_PARALLEL_PORT=DISABLE;
|
||||||
|
# write to FLASH possible from user bitstream:
|
||||||
|
SYSCONFIG CONFIG_IOVOLTAGE=3.3 COMPRESS_CONFIG=ON MCCLK_FREQ=62 SLAVE_SPI_PORT=DISABLE MASTER_SPI_PORT=DISABLE SLAVE_PARALLEL_PORT=DISABLE;
|
||||||
|
|
||||||
|
## LED indicators "blinkey" and "gpio" sheet
|
||||||
|
LOCATE COMP "led[3]" SITE "C1";
|
||||||
|
LOCATE COMP "led[2]" SITE "B3";
|
||||||
|
LOCATE COMP "led[1]" SITE "B1";
|
||||||
|
LOCATE COMP "led[0]" SITE "B2";
|
||||||
|
IOBUF PORT "led[0]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "led[1]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "led[2]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "led[3]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
|
||||||
|
## Buttons "blinkey" and "gpio" sheet
|
||||||
|
LOCATE COMP "btn[1]" SITE "C3";
|
||||||
|
LOCATE COMP "btn[2]" SITE "C2";
|
||||||
|
IOBUF PORT "btn[1]" PULLMODE=DOWN IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "btn[2]" PULLMODE=DOWN IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
|
||||||
|
## SPI Flash chip "flash" sheet
|
||||||
|
LOCATE COMP "flash_csn" SITE "R2";
|
||||||
|
LOCATE COMP "flash_clk" SITE "U3";
|
||||||
|
LOCATE COMP "flash_mosi" SITE "W2";
|
||||||
|
LOCATE COMP "flash_miso" SITE "V2";
|
||||||
|
LOCATE COMP "flash_holdn" SITE "W1";
|
||||||
|
LOCATE COMP "flash_wpn" SITE "Y2";
|
||||||
|
#LOCATE COMP "flash_csspin" SITE "AJ3";
|
||||||
|
#LOCATE COMP "flash_initn" SITE "AG4";
|
||||||
|
#LOCATE COMP "flash_done" SITE "AJ4";
|
||||||
|
#LOCATE COMP "flash_programn" SITE "AH4";
|
||||||
|
#LOCATE COMP "flash_cfg_select[0]" SITE "AM4";
|
||||||
|
#LOCATE COMP "flash_cfg_select[1]" SITE "AL4";
|
||||||
|
#LOCATE COMP "flash_cfg_select[2]" SITE "AK4";
|
||||||
|
IOBUF PORT "flash_csn" PULLMODE=UP IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "flash_clk" PULLMODE=DOWN IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "flash_mosi" PULLMODE=UP IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "flash_miso" PULLMODE=UP IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "flash_holdn" PULLMODE=UP IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "flash_wpn" PULLMODE=UP IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
#IOBUF PORT "flash_csspin" PULLMODE=UP IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
#IOBUF PORT "flash_initn" PULLMODE=UP IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
#IOBUF PORT "flash_done" PULLMODE=UP IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
#IOBUF PORT "flash_programn" PULLMODE=UP IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
#IOBUF PORT "flash_cfg_select[0]" PULLMODE=DOWN IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
#IOBUF PORT "flash_cfg_select[1]" PULLMODE=DOWN IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
#IOBUF PORT "flash_cfg_select[2]" PULLMODE=DOWN IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
|
||||||
|
## SD card "sdcard", "usb" sheet
|
||||||
|
LOCATE COMP "sd_clk" SITE "H2"; # sd_clk WiFi_GPIO14 CM4_GPIO12
|
||||||
|
LOCATE COMP "sd_cmd" SITE "J1"; # sd_cmd_di (MOSI) WiFi_GPIO15 CM4_GPIO27
|
||||||
|
LOCATE COMP "sd_d[0]" SITE "J3"; # sd_dat0_do (MISO) WiFi_GPIO2 CM4_GPIO4
|
||||||
|
LOCATE COMP "sd_d[1]" SITE "H1"; # sd_dat1_irq WiFi_GPIO4 CM4_GPIO3
|
||||||
|
LOCATE COMP "sd_d[2]" SITE "K1"; # sd_dat2 WiFi_GPIO12 CM4_GPIO2
|
||||||
|
LOCATE COMP "sd_d[3]" SITE "K2"; # sd_dat3_csn WiFi_GPIO13 CM4_GPIO14
|
||||||
|
LOCATE COMP "sd_wp" SITE "P5"; # not connected
|
||||||
|
LOCATE COMP "sd_cdn" SITE "N5"; # not connected
|
||||||
|
IOBUF PORT "sd_clk" PULLMODE=UP IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "sd_cmd" PULLMODE=UP IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "sd_d[0]" PULLMODE=UP IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "sd_d[1]" PULLMODE=UP IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "sd_d[2]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4; # WiFi GPIO12 pulldown bootstrapping requirement
|
||||||
|
IOBUF PORT "sd_d[3]" PULLMODE=UP IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "sd_wp" PULLMODE=UP IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "sd_cdn" PULLMODE=UP IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
LOCATE COMP "sd_pwr_on" SITE "U17"; # J2_5- GN14
|
||||||
|
IOBUF PORT "sd_pwr_on" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
|
||||||
|
## Second USB port "US2" going directly into FPGA "usb", "ram" sheet
|
||||||
|
LOCATE COMP "usb_fpga_dp" SITE "E16"; # same on ULX3S and ULX4M
|
||||||
|
LOCATE COMP "usb_fpga_dn" SITE "F16"; # same on ULX3S and ULX4M
|
||||||
|
IOBUF PORT "usb_fpga_dp" PULLMODE=NONE IO_TYPE=LVCMOS33D DRIVE=16;
|
||||||
|
IOBUF PORT "usb_fpga_dn" PULLMODE=NONE IO_TYPE=LVCMOS33D DRIVE=16;
|
||||||
|
LOCATE COMP "usb_fpga_bd_dp" SITE "D15"; # single-ended bidirectional same on ULX3S and ULX4M
|
||||||
|
LOCATE COMP "usb_fpga_bd_dn" SITE "E15"; # single-ended bidirectional same on ULX3S and ULX4M
|
||||||
|
IOBUF PORT "usb_fpga_bd_dp" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "usb_fpga_bd_dn" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
LOCATE COMP "usb_fpga_pu_dp" SITE "A2"; # pull up/down control
|
||||||
|
LOCATE COMP "usb_fpga_pu_dn" SITE "A3";
|
||||||
|
IOBUF PORT "usb_fpga_pu_dp" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=16;
|
||||||
|
IOBUF PORT "usb_fpga_pu_dn" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=16;
|
||||||
|
LOCATE COMP "usb_fpga_otg_id" SITE "A4";
|
||||||
|
IOBUF PORT "usb_fpga_otg_id" PULLMODE=UP IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
LOCATE COMP "n_extrst" SITE "U16";
|
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|
IOBUF PORT "n_extrst" PULLMODE=UP IO_TYPE=LVCMOS33 DRIVE=4;
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## JTAG ESP-32 "usb" sheet
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# connected to FT231X and ESP-32
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# commented out because those are dedicated pins, not directly useable as GPIO
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# but could be used by some vendor-specific JTAG bridging (boundary scan) module
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#LOCATE COMP "jtag_tdi" SITE "R5"; # FTDI_nRI FPGA receives
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#LOCATE COMP "jtag_tdo" SITE "V4"; # FTDI_nCTS FPGA transmits
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#LOCATE COMP "jtag_tck" SITE "T5"; # FTDI_nDSR FPGA receives
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#LOCATE COMP "jtag_tms" SITE "U5"; # FTDI_nDCD FPGA receives
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#IOBUF PORT "jtag_tdi" PULLMODE=UP IO_TYPE=LVCMOS33 DRIVE=4;
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#IOBUF PORT "jtag_tdo" PULLMODE=UP IO_TYPE=LVCMOS33 DRIVE=4;
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#IOBUF PORT "jtag_tck" PULLMODE=UP IO_TYPE=LVCMOS33 DRIVE=4;
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#IOBUF PORT "jtag_tms" PULLMODE=UP IO_TYPE=LVCMOS33 DRIVE=4;
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## SDRAM "ram" sheet
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LOCATE COMP "sdram_clk" SITE "G19";
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LOCATE COMP "sdram_cke" SITE "G20";
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LOCATE COMP "sdram_csn" SITE "P18";
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LOCATE COMP "sdram_wen" SITE "N20";
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LOCATE COMP "sdram_rasn" SITE "M18";
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LOCATE COMP "sdram_casn" SITE "N18";
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LOCATE COMP "sdram_a[0]" SITE "L19";
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LOCATE COMP "sdram_a[1]" SITE "L20";
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LOCATE COMP "sdram_a[2]" SITE "M19";
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LOCATE COMP "sdram_a[3]" SITE "H17";
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LOCATE COMP "sdram_a[4]" SITE "F20";
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LOCATE COMP "sdram_a[5]" SITE "F18";
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LOCATE COMP "sdram_a[6]" SITE "E19";
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LOCATE COMP "sdram_a[7]" SITE "F19";
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LOCATE COMP "sdram_a[8]" SITE "E20";
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LOCATE COMP "sdram_a[9]" SITE "C20";
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LOCATE COMP "sdram_a[10]" SITE "N19";
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LOCATE COMP "sdram_a[11]" SITE "D20";
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LOCATE COMP "sdram_a[12]" SITE "E18";
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LOCATE COMP "sdram_ba[0]" SITE "L18";
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LOCATE COMP "sdram_ba[1]" SITE "M20";
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LOCATE COMP "sdram_dqm[0]" SITE "P20";
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LOCATE COMP "sdram_dqm[1]" SITE "D19";
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LOCATE COMP "sdram_d[0]" SITE "U20";
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LOCATE COMP "sdram_d[1]" SITE "T20";
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LOCATE COMP "sdram_d[2]" SITE "U19";
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LOCATE COMP "sdram_d[3]" SITE "T19";
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LOCATE COMP "sdram_d[4]" SITE "T18";
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LOCATE COMP "sdram_d[5]" SITE "T17";
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LOCATE COMP "sdram_d[6]" SITE "R20";
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|
LOCATE COMP "sdram_d[7]" SITE "P19";
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LOCATE COMP "sdram_d[8]" SITE "H20";
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LOCATE COMP "sdram_d[9]" SITE "J19";
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LOCATE COMP "sdram_d[10]" SITE "K18";
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|
LOCATE COMP "sdram_d[11]" SITE "J18";
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LOCATE COMP "sdram_d[12]" SITE "H18";
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|
LOCATE COMP "sdram_d[13]" SITE "J16";
|
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|
LOCATE COMP "sdram_d[14]" SITE "K19";
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|
LOCATE COMP "sdram_d[15]" SITE "J17";
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|
IOBUF PORT "sdram_clk" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
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IOBUF PORT "sdram_cke" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
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|
IOBUF PORT "sdram_csn" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
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|
IOBUF PORT "sdram_wen" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
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|
IOBUF PORT "sdram_rasn" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
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|
IOBUF PORT "sdram_casn" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
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|
IOBUF PORT "sdram_a[0]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
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|
IOBUF PORT "sdram_a[1]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
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|
IOBUF PORT "sdram_a[2]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
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|
IOBUF PORT "sdram_a[3]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
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|
IOBUF PORT "sdram_a[4]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
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|
IOBUF PORT "sdram_a[5]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
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|
IOBUF PORT "sdram_a[6]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
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|
IOBUF PORT "sdram_a[7]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
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|
IOBUF PORT "sdram_a[8]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
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|
IOBUF PORT "sdram_a[9]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
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|
IOBUF PORT "sdram_a[10]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
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|
IOBUF PORT "sdram_a[11]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
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|
IOBUF PORT "sdram_a[12]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
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|
IOBUF PORT "sdram_ba[0]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
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|
IOBUF PORT "sdram_ba[1]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "sdram_dqm[0]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
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|
IOBUF PORT "sdram_dqm[1]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
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|
IOBUF PORT "sdram_d[0]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
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|
IOBUF PORT "sdram_d[1]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
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|
IOBUF PORT "sdram_d[2]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
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|
IOBUF PORT "sdram_d[3]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
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|
IOBUF PORT "sdram_d[4]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
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|
IOBUF PORT "sdram_d[5]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
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|
IOBUF PORT "sdram_d[6]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
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|
IOBUF PORT "sdram_d[7]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "sdram_d[8]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
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|
IOBUF PORT "sdram_d[9]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
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|
IOBUF PORT "sdram_d[10]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
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|
IOBUF PORT "sdram_d[11]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "sdram_d[12]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
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|
IOBUF PORT "sdram_d[13]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
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|
IOBUF PORT "sdram_d[14]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
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|
IOBUF PORT "sdram_d[15]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
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# GPDI differential interface (Video) "gpdi" sheet
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LOCATE COMP "gpdi_dp[0]" SITE "F17"; # Blue +
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LOCATE COMP "gpdi_dn[0]" SITE "G18"; # Blue -
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LOCATE COMP "gpdi_dp[1]" SITE "D18"; # Green +
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LOCATE COMP "gpdi_dn[1]" SITE "E17"; # Green -
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LOCATE COMP "gpdi_dp[2]" SITE "C18"; # Red +
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|
LOCATE COMP "gpdi_dn[2]" SITE "D17"; # Red -
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|
LOCATE COMP "gpdi_dp[3]" SITE "J20"; # Clock +
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|
LOCATE COMP "gpdi_dn[3]" SITE "K20"; # Clock -
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#LOCATE COMP "gpdi_ethp" SITE "A19"; # Ethernet +
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#LOCATE COMP "gpdi_ethn" SITE "B20"; # Ethernet -
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LOCATE COMP "gpdi_cec" SITE "A18";
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#LOCATE COMP "gpdi_sda" SITE "B19"; # I2C shared with RTC
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#LOCATE COMP "gpdi_scl" SITE "E12"; # I2C shared with RTC C12->E12
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|
IOBUF PORT "gpdi_dp[0]" IO_TYPE=LVCMOS33 DRIVE=4;
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|
#IOBUF PORT "gpdi_dn[0]" IO_TYPE=LVCMOS33 DRIVE=4;
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|
IOBUF PORT "gpdi_dp[1]" IO_TYPE=LVCMOS33 DRIVE=4;
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|
#IOBUF PORT "gpdi_dn[1]" IO_TYPE=LVCMOS33 DRIVE=4;
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|
IOBUF PORT "gpdi_dp[2]" IO_TYPE=LVCMOS33 DRIVE=4;
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|
#IOBUF PORT "gpdi_dn[2]" IO_TYPE=LVCMOS33 DRIVE=4;
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||||||
|
IOBUF PORT "gpdi_dp[3]" IO_TYPE=LVCMOS33 DRIVE=4;
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||||||
|
#IOBUF PORT "gpdi_dn[3]" IO_TYPE=LVCMOS33 DRIVE=4;
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|
#IOBUF PORT "gpdi_ethp" IO_TYPE=LVCMOS33 DRIVE=4;
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|
#IOBUF PORT "gpdi_ethn" IO_TYPE=LVCMOS33 DRIVE=4;
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|
IOBUF PORT "gpdi_cec" PULLMODE=UP IO_TYPE=LVCMOS33 DRIVE=4;
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|
#IOBUF PORT "gpdi_sda" PULLMODE=UP IO_TYPE=LVCMOS33 DRIVE=4;
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|
#IOBUF PORT "gpdi_scl" PULLMODE=UP IO_TYPE=LVCMOS33 DRIVE=4;
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|
LOCATE COMP "gpdi_dp[4]" SITE "B9"; # Blue +
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|
#LOCATE COMP "gpdi_dn[4]" SITE "C10"; # Blue -
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LOCATE COMP "gpdi_dp[5]" SITE "A7"; # Green +
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#LOCATE COMP "gpdi_dn[5]" SITE "A8"; # Green -
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LOCATE COMP "gpdi_dp[6]" SITE "C8"; # Red +
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#LOCATE COMP "gpdi_dn[6]" SITE "B8"; # Red -
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LOCATE COMP "gpdi_dp[7]" SITE "B11"; # Clock +
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#LOCATE COMP "gpdi_dn[7]" SITE "C11"; # Clock -
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|
IOBUF PORT "gpdi_dp[4]" IO_TYPE=LVCMOS33D DRIVE=4;
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|
IOBUF PORT "gpdi_dn[4]" IO_TYPE=LVCMOS33D DRIVE=4;
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|
IOBUF PORT "gpdi_dp[5]" IO_TYPE=LVCMOS33D DRIVE=4;
|
||||||
|
IOBUF PORT "gpdi_dn[5]" IO_TYPE=LVCMOS33D DRIVE=4;
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||||||
|
IOBUF PORT "gpdi_dp[6]" IO_TYPE=LVCMOS33D DRIVE=4;
|
||||||
|
IOBUF PORT "gpdi_dn[6]" IO_TYPE=LVCMOS33D DRIVE=4;
|
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|
IOBUF PORT "gpdi_dp[7]" IO_TYPE=LVCMOS33D DRIVE=4;
|
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|
IOBUF PORT "gpdi_dn[7]" IO_TYPE=LVCMOS33D DRIVE=4;
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|
# wifi - do not use together with CM4 GPIO
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LOCATE COMP "wifi_gpio0" SITE "U1";
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LOCATE COMP "wifi_gpio2" SITE "K4"; # sd_d0_do (MISO) WiFi GPIO2
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LOCATE COMP "wifi_gpio4" SITE "J5"; # sd_d1_irq WiFi GPIO4
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|
LOCATE COMP "wifi_gpio5" SITE "U5"; #
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LOCATE COMP "wifi_gpio12" SITE "K5"; # sd_d2 WiFi_GPIO12
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LOCATE COMP "wifi_gpio13" SITE "L4"; # sd_d3_csn WiFi_GPIO13
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LOCATE COMP "wifi_gpio14" SITE "L5"; # sd_clk WiFi_GPIO14
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|
LOCATE COMP "wifi_gpio15" SITE "N16"; # sd_cmd_di (MOSI) WiFi GPIO15
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|
LOCATE COMP "wifi_gpio19" SITE "P4";
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|
LOCATE COMP "wifi_gpio21" SITE "P17";
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|
LOCATE COMP "wifi_gpio22" SITE "P16";
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|
LOCATE COMP "wifi_gpio25" SITE "L16";
|
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|
LOCATE COMP "wifi_gpio26" SITE "N17";
|
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|
LOCATE COMP "wifi_gpio27" SITE "G16";
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|
LOCATE COMP "wifi_gpio33" SITE "H16";
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|
LOCATE COMP "wifi_gpio34" SITE "V4";
|
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|
LOCATE COMP "wifi_gpio35" SITE "N17";
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|
IOBUF PORT "wifi_gpio0" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
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|
IOBUF PORT "wifi_gpio2" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4; # pull down or drive 0 for esp32 programming
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|
IOBUF PORT "wifi_gpio4" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "wifi_gpio5" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "wifi_gpio12" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
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|
IOBUF PORT "wifi_gpio13" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4; # pull down or drive 0 for esp32 programming
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|
IOBUF PORT "wifi_gpio14" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
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|
IOBUF PORT "wifi_gpio15" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "wifi_gpio19" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "wifi_gpio21" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "wifi_gpio22" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "wifi_gpio25" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "wifi_gpio26" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "wifi_gpio27" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "wifi_gpio33" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "wifi_gpio34" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
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|
IOBUF PORT "wifi_gpio35" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
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|
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|
LOCATE COMP "ftdi_txden" SITE "T1"; # FTDI_TXDEN
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|
LOCATE COMP "LED1_HAT" SITE "N5"; # LED1 on HAT
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LOCATE COMP "wifi_en" SITE "U18";# WIFI_EN
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LOCATE COMP "ftdi_txd" SITE "N4"; # FTDI_TXD
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|
LOCATE COMP "ftdi_rxd" SITE "N3"; # FTDI_RXD
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|
LOCATE COMP "wifi_txd" SITE "P5"; # WIFI_TXD
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|
LOCATE COMP "wifi_rxd" SITE "V1"; # WIFI_RXD
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|
IOBUF PORT "ftdi_txden" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
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|
IOBUF PORT "LED1_HAT" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "wifi_en" PULLMODE=UP IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "ftdi_txd" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "ftdi_rxd" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "wifi_txd" PULLMODE=UP IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "wifi_rxd" PULLMODE=UP IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
|
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|
LOCATE COMP "btn[3]" SITE "E3";
|
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|
LOCATE COMP "btn[4]" SITE "E4";
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|
LOCATE COMP "btn[5]" SITE "E5";
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|
LOCATE COMP "btn[6]" SITE "H5";
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|
LOCATE COMP "btn[0]" SITE "H4";
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|
LOCATE COMP "nc1" SITE "F2";
|
||||||
|
LOCATE COMP "sw" SITE "G3";
|
||||||
|
IOBUF PORT "btn[3]" PULLMODE=UP IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "btn[4]" PULLMODE=UP IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "btn[5]" PULLMODE=UP IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "btn[6]" PULLMODE=UP IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "btn[0]" PULLMODE=DOWN IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "nc1" PULLMODE=UP IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "sw[0]" PULLMODE=UP IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
|
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|
## CM4 GPIO
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|
LOCATE COMP "gpio[0]" SITE "R16"; # SDA0 - WIFI_GPIO21
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|
LOCATE COMP "gpio[1]" SITE "R17"; # SCL0 - WIFI_GPIO22
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||||||
|
LOCATE COMP "gpio[2]" SITE "K5"; # SD_D2 - ESP32 SD share
|
||||||
|
LOCATE COMP "gpio[3]" SITE "J5"; # SD_D1 - ESP32 SD share
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||||||
|
LOCATE COMP "gpio[4]" SITE "K4"; # SD_D0 - ESP32 SD share
|
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|
LOCATE COMP "gpio[5]" SITE "H16"; # WIFI_GPIO33
|
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|
LOCATE COMP "gpio[6]" SITE "R1"; # BTN1 on HAT
|
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|
LOCATE COMP "gpio[7]" SITE "P3"; # BTN2 on HAT
|
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|
LOCATE COMP "gpio[8]" SITE "P4"; # WIFI_GPIO19
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|
LOCATE COMP "gpio[9]" SITE "G16"; # WIFI_GPIO27
|
||||||
|
LOCATE COMP "gpio[10]" SITE "N17";# WIFI_GPIO26
|
||||||
|
LOCATE COMP "gpio[11]" SITE "L16";# WIFI_GPIO25
|
||||||
|
LOCATE COMP "gpio[12]" SITE "C4"; # FPGA TDI do not use - not connected!
|
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|
LOCATE COMP "gpio[13]" SITE "T1"; # FTDI_TXDEN
|
||||||
|
LOCATE COMP "gpio[14]" SITE "L4"; # SD_D3 - ESP32 SD share
|
||||||
|
LOCATE COMP "gpio[15]" SITE "L5"; # SD_CLK - ESP32 SD share
|
||||||
|
LOCATE COMP "gpio[16]" SITE "B4"; # FPGA TDO do not use - not connected!
|
||||||
|
LOCATE COMP "gpio[17]" SITE "M17";# WIFI_GPIO35
|
||||||
|
LOCATE COMP "gpio[18]" SITE "N5"; # LED1 on HAT
|
||||||
|
LOCATE COMP "gpio[19]" SITE "U1"; # WIFI_GPIO0
|
||||||
|
LOCATE COMP "gpio[20]" SITE "E4"; # FPGA TCK do not use - not connected!
|
||||||
|
LOCATE COMP "gpio[21]" SITE "D5"; # FPGA TMS do not use - not connected!
|
||||||
|
LOCATE COMP "gpio[22]" SITE "U18";# WIFI_EN
|
||||||
|
LOCATE COMP "gpio[23]" SITE "N4"; # FTDI_TXD
|
||||||
|
LOCATE COMP "gpio[24]" SITE "N3"; # FTDI_RXD
|
||||||
|
LOCATE COMP "gpio[25]" SITE "P5"; # WIFI_TXD
|
||||||
|
LOCATE COMP "gpio[26]" SITE "V1"; # WIFI_RXD
|
||||||
|
LOCATE COMP "gpio[27]" SITE "N16";# SD_CMD - ESP32 SD share
|
||||||
|
IOBUF PORT "gpio[0]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "gpio[1]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "gpio[2]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "gpio[3]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "gpio[4]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "gpio[5]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "gpio[6]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "gpio[7]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "gpio[8]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "gpio[9]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "gpio[10]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "gpio[11]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "gpio[12]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "gpio[13]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "gpio[14]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "gpio[15]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "gpio[16]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "gpio[17]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "gpio[18]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "gpio[19]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "gpio[20]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "gpio[21]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "gpio[22]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "gpio[23]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "gpio[24]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "gpio[25]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "gpio[26]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
IOBUF PORT "gpio[27]" PULLMODE=NONE IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
|
|
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|
## DSI
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|
#
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LOCATE COMP "dsiRX0_dp[0]" SITE "B12"; # Clk +
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|
LOCATE COMP "dsiRX0_dn[0]" SITE "C12"; # Clk -
|
||||||
|
LOCATE COMP "dsiRX0_dp[1]" SITE "A12"; # DSI RX D0 +
|
||||||
|
LOCATE COMP "dsiRX0_dn[1]" SITE "A13"; # DSI RX D0 -
|
||||||
|
LOCATE COMP "dsiRX0_dp[2]" SITE "B13"; # DSI RX D1 +
|
||||||
|
LOCATE COMP "dsiRX0_dn[2]" SITE "C13"; # DSI RX D1 -
|
||||||
|
LOCATE COMP "dsiTX0_dp[0]" SITE "D12"; # Clk +
|
||||||
|
LOCATE COMP "dsiTX0_dn[0]" SITE "E12"; # Clk -
|
||||||
|
LOCATE COMP "dsiTX0_dp[1]" SITE "D13"; # DSI TX D0 +
|
||||||
|
LOCATE COMP "dsiTX0_dn[1]" SITE "E13"; # DSI TX D0 -
|
||||||
|
LOCATE COMP "dsiTX0_dp[2]" SITE "A14"; # DSI TX D1 +
|
||||||
|
LOCATE COMP "dsiTX0_dn[2]" SITE "C14"; # DSI TX D1 -
|
||||||
|
IOBUF PORT "dsiRX0_dp[0]" IO_TYPE=LVCMOS12 ;
|
||||||
|
IOBUF PORT "dsiRX0_dn[0]" IO_TYPE=LVCMOS12 ;
|
||||||
|
IOBUF PORT "dsiRX0_dp[1]" IO_TYPE=LVCMOS12 ;
|
||||||
|
IOBUF PORT "dsiRX0_dn[1]" IO_TYPE=LVCMOS12 ;
|
||||||
|
IOBUF PORT "dsiRX0_dp[2]" IO_TYPE=LVCMOS12 ;
|
||||||
|
IOBUF PORT "dsiRX0_dn[2]" IO_TYPE=LVCMOS12 ;
|
||||||
|
IOBUF PORT "dsiTX0_dp[0]" IO_TYPE=LVCMOS12 ;
|
||||||
|
IOBUF PORT "dsiTX0_dp[0]" IO_TYPE=LVCMOS12 ;
|
||||||
|
IOBUF PORT "dsiTX0_dp[1]" IO_TYPE=LVCMOS12 ;
|
||||||
|
IOBUF PORT "dsiTX0_dp[1]" IO_TYPE=LVCMOS12 ;
|
||||||
|
IOBUF PORT "dsiTX0_dp[2]" IO_TYPE=LVCMOS12 ;
|
||||||
|
IOBUF PORT "dsiTX0_dp[2]" IO_TYPE=LVCMOS12 ;
|
||||||
|
|
||||||
|
## PROGRAMN (reload bitstream from FLASH, exit from bootloader)
|
||||||
|
# PCB v2.0.5 and higher
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|
LOCATE COMP "user_programn" SITE "M4";
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||||||
|
IOBUF PORT "user_programn" PULLMODE=UP IO_TYPE=LVCMOS33 DRIVE=4;
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||||||
|
|
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|
## SHUTDOWN "power", "ram" sheet (connected from PCB v1.7.5)
|
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|
# on PCB v1.7 shutdown is not connected to FPGA
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|
LOCATE COMP "shutdown" SITE "G16"; # FPGA receives
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|
IOBUF PORT "shutdown" PULLMODE=DOWN IO_TYPE=LVCMOS33 DRIVE=4;
|
||||||
730
Verilator_Tests/spi/wave.vcd
Normal file
730
Verilator_Tests/spi/wave.vcd
Normal file
@@ -0,0 +1,730 @@
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$version Generated by VerilatedVcd $end
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$timescale 1ps $end
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$scope module TOP $end
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$var wire 1 # clk_25mhz $end
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$var wire 1 $ spi_clk $end
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$var wire 1 % spi_mosi $end
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|
$var wire 1 ' spi_cs $end
|
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|
$scope module top $end
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||||||
|
$var wire 1 # clk_25mhz $end
|
||||||
|
$var wire 1 $ spi_clk $end
|
||||||
|
$var wire 1 % spi_mosi $end
|
||||||
|
$var wire 1 & spi_miso $end
|
||||||
|
$var wire 1 ' spi_cs $end
|
||||||
|
$var wire 8 ( mosi_shift [7:0] $end
|
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|
$var wire 4 ) bit_counter [3:0] $end
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$var wire 1 * spi_clk_en $end
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$upscope $end
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$upscope $end
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$enddefinitions $end
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#100
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b10101100 (
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b0010 )
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b10000000 (
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#580
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#740
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#760
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b1010 )
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1#
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b1110 )
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#2380
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1#
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#2420
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